적극적 생각/FPGA

0802 / HW 가속기 설계 연습. 8b 곱셈 Core 설계 (2)

무말랭이 2022. 8. 2. 08:49

 

(지금 만들어진 C파일을 '펌웨어'라고 인식해도 맞음)

여기서 sl 연산 사용됨 주목

구간별 런타임 시간측정. 및 누적합(HW Processing Time).

HW result buffer 와 SW result buffer 의 매칭

(하드웨어 런타임 측정을 위해

암 코어텍스 프로세스의 

주파수 값을 참고하여 계산할 수 있음.)

계산은 1us만 하는데

이동하는데 860*2us의 시간을 사용하고 있다.

ㅋㅋㅋㅋㅋㅋㅋㅋ

그래서 지금은 적합하지 않고

하드웨어가 더 느린 상태이다.

 

 

(인터페이스 하나만으로 강좌 하나가 나올 수 있기 때문에

지금 설계된 이 모듈을

AXI4 등 다른 인터페이스로 갈아끼우는 것이 또 매우 중요한 큰 과제이다.)