말랑말랑

input node 개수에 따른 연산 오류 : https://inf.run/2xrK FPGA21장 - fully connected layer 설계 - 코드 리뷰 편에서 질문 있습니다 - 인프런 | 질문 & 답변 https://www.inflearn.com/questions/330774 FPGA21장에서, FC layer에 대한 의문이 있어서 질문을 찾아본 결과, 위 링크의 질문자와 비슷한 질문이 생겼습니다. [사진] [사진] 위의 test.c 코드대로라면, 입력 노 www.inflearn.com diff 여기서부터는 응용의 영역

지난번에 해결되지 않은 부분에서 이 접근 방법으로 간단하게 해결할 수 있을 것 같다는 느낌이 든다. 전체 워크플로우를 장악하지 못하고 있기 때문에 생기는 문제였던 것 같음. 더욱 순차적으로 접근할 것.

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구글 포토를 이용해서 사진 10000장 동영상 600개를 백업하는 중인데 진짜 시간 오래걸린다. 이건 클라우드의 상황인데 평소 SSD 같은 장치를 통해서 저장할 때도 시간이 동일히 엄청 많이 걸린다.

NPU는 Inference를 할 때 쓰는 칩이다. 총 필요한 weight의 수. = N*M개

(지금 만들어진 C파일을 '펌웨어'라고 인식해도 맞음) 여기서 sl 연산 사용됨 주목 구간별 런타임 시간측정. 및 누적합(HW Processing Time). HW result buffer 와 SW result buffer 의 매칭 (하드웨어 런타임 측정을 위해 암 코어텍스 프로세스의 주파수 값을 참고하여 계산할 수 있음.) 계산은 1us만 하는데 이동하는데 860*2us의 시간을 사용하고 있다. ㅋㅋㅋㅋㅋㅋㅋㅋ 그래서 지금은 적합하지 않고 하드웨어가 더 느린 상태이다. (인터페이스 하나만으로 강좌 하나가 나올 수 있기 때문에 지금 설계된 이 모듈을 AXI4 등 다른 인터페이스로 갈아끼우는 것이 또 매우 중요한 큰 과제이다.)

삼성 들어가서 (들어가야하겠지만...ㅎㅎ) 최소 4년 채우고 싶다. 이건 다짐의 영역인듯하다.

Reference C 9.3 Golden Reference Models https://www.syncad.com/web_manual_testbencher/test_bench_generator_main_index.html?golden_reference_models.htm TestBencher Pro and Reactive Test Bench Help www.syncad.com delay 하던 부분에 대하여 mul core로 대체함 어려운건 data를 이동시키는 과정이며 과정 전체에서 data mover의 내용을 가장 잘 장악해야한다. 곱셈같은 경우는 합성 단계에서 알아서 잘 처리해주기 때문에 굳이 low level로 낮출 필요는 없다. c를 먼저 실행하는 workflow로 진행된다. make를 통한 실행 ..